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エラーでなけりゃOK?違うの?CPU負荷とか関係していたら違ってくるかもだけど# CPU内部キャッシュはECC無くていいのか そしたら内部レジスタにもECC要る?# 宇宙用とかだと付いているかもしれないな
数年前の学会でXeonの信頼性の話を聞いて、XeonはキャッシュにECCありでCoreシリーズはなしとか言ってたような。ついでにXeonのMP向けはレジスタを二重化してるとか言ってた。#ソース忘れたので話半分でどうぞ
他にもARMの高性能コアIPだと、L1/L2キャッシュのECCあり/なし選べますね。クライアント向けは普通なし選んでると思うのだけど、こっちも根拠レス。#あり/なし選択できるのは確か
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アレゲはアレゲ以上のなにものでもなさげ -- アレゲ研究家
MEMTEST86してみて (スコア:0)
エラーでなけりゃOK?違うの?
CPU負荷とか関係していたら違ってくるかもだけど
# CPU内部キャッシュはECC無くていいのか そしたら内部レジスタにもECC要る?
# 宇宙用とかだと付いているかもしれないな
Re:MEMTEST86してみて (スコア:2)
Re: (スコア:0)
数年前の学会でXeonの信頼性の話を聞いて、XeonはキャッシュにECCありでCoreシリーズはなしとか言ってたような。
ついでにXeonのMP向けはレジスタを二重化してるとか言ってた。
#ソース忘れたので話半分でどうぞ
他にもARMの高性能コアIPだと、L1/L2キャッシュのECCあり/なし選べますね。
クライアント向けは普通なし選んでると思うのだけど、こっちも根拠レス。
#あり/なし選択できるのは確か