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IA64にどうやって HT(Hyper Threading)を付け足すのか興味がある.
Pentium4は,スーパースケーラのアーキテクチャを取っているので,実行時に使用されるリソースが動的に決定される.だから,Pentium4に HTを実装ときに,アーキテクチャとの親和性が高いのはわかる.
IA64は VLIWのアーキテクチャだから,実行前にリソースの割り当てが決定されている.1つの命令ユニットにパックされたいくつかのopは,かならず同時に実行するはず.そういう前提で HTを実装すると,各リソースごとではなく,命令ユニットごとのスケジューリングにならないだろ
といった点を改善するために、純粋なVLIWではなく、並列可能性を明示したRISCの様な命令セットとなっているそうです。 (ここ [impress.co.jp]の一番下の章に少し載っています。)
IA64でコンパイラに移された重要な機能は、並列
なるほど.IA64は,普通のVLIWと全然違うわけですね.確かにこの方式であれば,HTの実装は楽そうですね.
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物事のやり方は一つではない -- Perlな人
CPUの未来 (スコア:3, 興味深い)
IA64にどうやって HT(Hyper Threading)を付け足すのか興味がある.
Pentium4は,スーパースケーラのアーキテクチャを取っているので,実行時に使用されるリソースが動的に決定される.だから,Pentium4に HTを実装ときに,アーキテクチャとの親和性が高いのはわかる.
IA64は VLIWのアーキテクチャだから,実行前にリソースの割り当てが決定されている.1つの命令ユニットにパックされたいくつかのopは,かならず同時に実行するはず.そういう前提で HTを実装すると,各リソースごとではなく,命令ユニットごとのスケジューリングにならないだろ
Re:CPUの未来 (スコア:1)
といった点を改善するために、純粋なVLIWではなく、並列可能性を明示したRISCの様な命令セットとなっているそうです。 (ここ [impress.co.jp]の一番下の章に少し載っています。)
IA64でコンパイラに移された重要な機能は、並列
Re:CPUの未来 (スコア:1)
なるほど.IA64は,普通のVLIWと全然違うわけですね.確かにこの方式であれば,HTの実装は楽そうですね.