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256MBに制限されていたPCIe BAR apertureをVRAM全域に拡大することで無制限のアクセスが可能になるって話らしいですけど、
https://www.tomshardware.com/news/amds-rx-6000-gpus-to-boost-perf-with... [tomshardware.com]> AMD says that the CPU and GPU are usually constrained to a 256MB ‘aperture’ for data transfers.
Xilinxが持つAXI4 IPには最大256「GB」のPCIe BAR apertureを設定できるAXI-PCIe Bridgeがあります。
https://www.xilinx.com/support/documentation/ip_documentation/axi_pcie... [xilinx.com]> PF0_BAR0_APERTURE_SIZE | Specifies the size of the PCIe BAR | 0x1F: 256 Gigabytes
Infinity Fabricは他社IPを容易に取り込める設計にしてあるそうなので、もしかしたらそんな理由なのかもしれません。
https://pc.watch.impress.co.jp/docs/column/kaigai/1053318.html [impress.co.jp]> 他社のIPをInfinity Fabricに取りこむことが容易になる仕様となっているという。
ちなみにNVIDIAもTegraでAXIを使って1GBのPCIe aptertureを実現していたようです。
https://http.download.nvidia.com/tegra-public-appnotes/pcie.html [nvidia.com]> The controller is accessible via a 1 GiB aperture of CPU-visible physical address space;
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長期的な見通しやビジョンはあえて持たないようにしてる -- Linus Torvalds
Xilinx買収はSmart Access Memoryのため? (スコア:0)
256MBに制限されていたPCIe BAR apertureをVRAM全域に拡大することで無制限のアクセスが可能になるって話らしいですけど、
https://www.tomshardware.com/news/amds-rx-6000-gpus-to-boost-perf-with... [tomshardware.com]
> AMD says that the CPU and GPU are usually constrained to a 256MB ‘aperture’ for data transfers.
Xilinxが持つAXI4 IPには最大256「GB」のPCIe BAR apertureを設定できるAXI-PCIe Bridgeがあります。
https://www.xilinx.com/support/documentation/ip_documentation/axi_pcie... [xilinx.com]
> PF0_BAR0_APERTURE_SIZE | Specifies the size of the PCIe BAR | 0x1F: 256 Gigabytes
Infinity Fabricは他社IPを容易に取り込める設計にしてあるそうなので、もしかしたらそんな理由なのかもしれません。
https://pc.watch.impress.co.jp/docs/column/kaigai/1053318.html [impress.co.jp]
> 他社のIPをInfinity Fabricに取りこむことが容易になる仕様となっているという。
ちなみにNVIDIAもTegraでAXIを使って1GBのPCIe aptertureを実現していたようです。
https://http.download.nvidia.com/tegra-public-appnotes/pcie.html [nvidia.com]
> The controller is accessible via a 1 GiB aperture of CPU-visible physical address space;