gm300の日記: SiPのメリット
日記 by
gm300
xilinx からのお誘いを読んでいる途中で、突然思い出す。
FPGA を使う新しいメリットは高速I/Oだ。旧世代のASICでは難しい高速なI/Oが金さえだせば簡単に買える。I/O cellだけならASIC に入れるのは簡単だ。しかし実際に使うのはたぶんすごく大変だ。昔、「それはF1で近所へ買い物に行くようなものだ。」と聞いた。通れる道は少ないし、緊張する割りにメリットがない。ASIC はあってもボードの設計も大変だし、ソフトも面倒。FPGAも同じだが、同じFPGAを使う人がいる以上、参考になるデータを得る可能性がある。少なくてもreference design は存在する。
そこまでいかなくても、今問題なのはDDRxだろう。無印DDRからみればだいぶシステマテッィクになってきたが、速度が速いぶんだけ難しくもなっている。chipこみでSPICEで様子を見ないとなかなか性能を生かすことができない。しかし SiPなら別だ。なぜならSiPの中にDDR は入っていて外からは見えないからだ。SiPを使う一方の人からみればDDRの物理設計上の問題は全部解決だ。2ndソースの話も全部SiP供給者に押し付ければいい。
FPGA を使う新しいメリットは高速I/Oだ。旧世代のASICでは難しい高速なI/Oが金さえだせば簡単に買える。I/O cellだけならASIC に入れるのは簡単だ。しかし実際に使うのはたぶんすごく大変だ。昔、「それはF1で近所へ買い物に行くようなものだ。」と聞いた。通れる道は少ないし、緊張する割りにメリットがない。ASIC はあってもボードの設計も大変だし、ソフトも面倒。FPGAも同じだが、同じFPGAを使う人がいる以上、参考になるデータを得る可能性がある。少なくてもreference design は存在する。
そこまでいかなくても、今問題なのはDDRxだろう。無印DDRからみればだいぶシステマテッィクになってきたが、速度が速いぶんだけ難しくもなっている。chipこみでSPICEで様子を見ないとなかなか性能を生かすことができない。しかし SiPなら別だ。なぜならSiPの中にDDR は入っていて外からは見えないからだ。SiPを使う一方の人からみればDDRの物理設計上の問題は全部解決だ。2ndソースの話も全部SiP供給者に押し付ければいい。
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